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基于DDS和PLL的扫频信号源设计

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基于DDS和PLL的扫频信号源设计
论文目录
 
摘要第1-3 页
Abstract第3-6 页
1 绪论第6-11 页
  · 引言第6-7 页
  · 频率合成技术的发展过程第7-8 页
  · 频率合成技术的近况与展望第8-10 页
  · 论文的主要研究工作第10-11 页
2 直接数字频率合成技术简介第11-30 页
  · 引言第11-12 页
  · DDS的基本原理第12-15 页
    · DDS的理论基础和基本结构第12-13 页
    · DDS的原理第13-15 页
  · DDS的结构第15-16 页
    · 相位累加器第15-16 页
    · 正弦查询表ROM第16 页
    · 数模转换器DAC第16 页
  · DDS的数学综合第16-18 页
  · 理想的DDS输出频谱第18-20 页
  · DDS实际输出频谱杂散来源第20-29 页
    · DDS的相位误差序列第22-24 页
    · 相位截断对DDS输出频谱的影响第24-25 页
    · 幅度量化对DDS输出频谱的影响第25-28 页
    · DAC的非线性误差第28-29 页
  · 本章小结第29-30 页
3 AD9854简介及硬件电路设计第30-37 页
  · AD9854简介第30 页
  · 电路设计及测试结果第30-36 页
  · 本章小结第36-37 页
4 锁相频率合成器简介第37-44 页
  · 引言第37 页
  · 锁相环(PLL)的结构及基本原理第37-39 页
    · 鉴相器(PD)第37-38 页
    · 环路滤波器(LPF)第38 页
    · 压控振荡器(VCO)第38-39 页
  · 锁相环路的相位模型和动态方程第39-41 页
  · 锁相环路主要特性分析第41-43 页
    · 锁相环路的跟踪性能分析第41 页
    · 锁相环路的捕捉性能分析第41-42 页
    · 锁相环路的嗓声性能分析第42-43 页
  · 本章小结第43-44 页
5 ADF4106简介及其硬件电路的设计第44-51 页
  · 锁相环芯片ADF4106简介第44 页
  · 锁相环ADF4106的仿真第44-50 页
  · 本章小结第50-51 页
6 DDS+PLL捷变源的实现第51-56 页
  · DDS+PLL频率合成概述第51-52 页
  · 采用DDS+PLL的捷变源的几种方案及其可行性论证第52-53 页
    · DDS与PLL混频输出方案第52 页
    · DDS激励PLL的锁相倍频方案第52-53 页
  · 采用DDS激励PLL捷变源硬件电路设计第53-55 页
  · 本章小结第55-56 页
7 结论第56-57 页
致谢第57-58 页
参考文献第58-60 页

本篇论文共60页,点击这进入下载页面
 
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