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基于SOPC的动力调谐陀螺测试技术研究

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基于SOPC的动力调谐陀螺测试技术研究
论文目录
 
摘要第1-6 页
ABSTRACT第6-9 页
第1章 绪论第9-12 页
  · 动力调谐陀螺简介第9 页
  · 动力调谐陀螺漂移测试及类型第9-10 页
  · SOPC系统简介第10-11 页
  · 论文的主要工作第11-12 页
第2章 动力调谐陀螺的工作原理第12-30 页
  · 动力调谐陀螺仪的结构第12-13 页
  · 平衡环及动力调谐第13-21 页
    · 平衡环扭摆第13-17 页
    · 平衡环负弹性力矩第17-19 页
    · 动力调谐第19-21 页
  · 漂移模型的建立第21-29 页
    · 漂移的定义及类型第21-24 页
    · 力矩反馈法漂移测试的原理第24-25 页
    · 八位置测试法第25-29 页
  · 本章小结第29-30 页
第3章 陀螺数字力反馈系统设计第30-37 页
  · 数字力反馈系统原理第30-31 页
  · 数字力反馈系统的硬件设计第31-36 页
    · 前置放大器设计第31-32 页
    · 相敏解调器的设计第32 页
    · 校正环节的设计第32-33 页
    · 锯齿波发生器的设计第33-34 页
    · 脉冲调宽器的设计第34 页
    · 脉冲源的设计第34-35 页
    · 恒流源的设计第35-36 页
  · 本章小结第36-37 页
第4章 SOPC系统开发流程及开发平台第37-41 页
  · SOPC系统开发流程第37 页
  · SOPC系统开发软件平台第37-40 页
    · Quartus Ⅱ 7.0第37-39 页
    · Nios Ⅱ IDE 7.0第39-40 页
  · 本章小结第40-41 页
第5章 基于VHDL的硬件逻辑设计第41-57 页
  · VHDL语言介绍第41-43 页
  · 计数电路的VHDL语言描述及其功能仿真第43-56 页
    · 上层模块VHDL语言描述第44-46 页
    · 防抖电路VHDL语言描述第46 页
    · 计数模块VHDL语言描述第46-49 页
    · 锁存模块VHDL语言描述第49-50 页
    · 显示模块VHDL语言描述第50-54 页
    · 分频模块VHDL语言描述第54-56 页
  · 本章小结第56-57 页
第6章 基于QuartusⅡ和SOPC Builder的硬件设计第57-70 页
  · 使用SOPC Builder构造Nios Ⅱ内核第57-65 页
    · Nios Ⅱ处理器内核(CPU)第57-58 页
    · 片内存储器第58 页
    · SDRAM控制器内核及外设第58-59 页
    · UART内核及外设第59-61 页
    · EPCS控制器内核外设第61-62 页
    · CFI(通用Flash接口)控制器内核及外设第62-65 页
    · 并行输入/输出(PIO)内核外设第65 页
  · 顶层模块设计第65-68 页
    · Nios Ⅱ系统第66-67 页
    · 锁相环和时钟电路第67-68 页
    · 自定义逻辑模块第68 页
  · 系统电源第68-69 页
  · 本章小结第69-70 页
第7章 系统软件设计及数据处理第70-78 页
  · 系统软件设计第70-76 页
    · 陀螺参数计算函数第71-73 页
    · 串口通讯函数第73-76 页
  · 实验结果及分析第76-77 页
  · 本章小结第77-78 页
结论第78-79 页
参考文献第79-81 页
攻读硕士学位期间发表的论文和取得的科研成果第81-82 页
致谢第82-83 页
附录A DTG力反馈系统电路板第83-84 页
附录B SOPC系统设计电路开发板第84页

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