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高性能DSP后端设计的功耗优化方法研究

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高性能DSP后端设计的功耗优化方法研究
论文目录
 
摘要第11-11页
ABSTRACT第11-13页
第一章 绪论第13-17页
  1.1 课题研究背景第13页
  1.2 低功耗技术的研究现状第13-14页
  1.3 低功耗技术面临的挑战第14-15页
  1.4 课题研究内容和意义第15页
  1.5 文章主题架构第15-17页
第二章 芯片功耗组成和分析第17-30页
  2.1 芯片功耗的来源第17-21页
    2.1.1 动态开关功耗第17-18页
    2.1.2 短路功耗第18-19页
    2.1.3 漏流功耗第19-21页
  2.2 低功耗技术简介第21-25页
    2.2.1 门控时钟技术第21-22页
    2.2.2 扫描链重定序第22-24页
    2.2.3 多位触发器融合第24-25页
  2.3 功耗分析工具第25-29页
    2.3.1 Prime Time PX第25-26页
    2.3.2 Redhawk第26-27页
    2.3.3 SpyGlass第27-29页
  2.4 本章小结第29-30页
第三章 小容量存储器的全定制功耗优化第30-43页
  3.1 电路设计第31-36页
    3.1.1 写路径第31-32页
    3.1.2 读路径第32页
    3.1.3 读写地址锁存及译码模块第32-33页
    3.1.4 时钟模块第33-34页
    3.1.5 电路的时序分析与优化第34-35页
    3.1.6 写入电路的时序分析与优化第35-36页
  3.2 版图设计第36-39页
    3.2.1 版图结构第36-37页
    3.2.2 存储阵列第37-38页
    3.2.3 译码与时钟模块第38-39页
    3.2.4 布线第39页
  3.3 面积、时序和功耗对比分析第39-41页
  3.4 本章小结第41-43页
第四章 FT-MX部分模块的物理设计功耗优化第43-60页
  4.1 DMA模块中非关键路径的功耗优化第43-47页
    4.1.1 对非关键路径单元的优化第46-47页
    4.1.2 功耗优化在DMA中的实现第47页
  4.2 触发器合并对乘法部件的功耗优化第47-52页
  4.3 SRIO模块时钟树的功耗优化第52-59页
    4.3.1 时钟树的结构分类第52-53页
    4.3.2 SRIO的时钟结构第53-55页
    4.3.3 SRIO的时钟规划第55-59页
  4.4 本章小结第59-60页
第五章 基于新型触发器的功耗优化第60-67页
  5.1 新型触发器的结构第60-62页
    5.1.1 YHFT-SPFF触发器第60-61页
    5.1.2 YHFT-SDFF触发器第61-62页
    5.1.3 YHFT-SCFF触发器第62页
  5.2 新型触发器在FT-MX中的应用第62-66页
    5.2.1 YHFT-SPFF、YHFT-SCFF触发器的应用第63-65页
    5.2.2 YHFT-SDFF触发器的应用第65-66页
  5.3 本章小结第66-67页
第六章 总结与展望第67-69页
  6.1 全文总结第67-68页
  6.2 工作展望第68-69页
致谢第69-71页
参考文献第71-75页
作者在学期间取得的学术成果第75页

本篇论文共75页,点击这进入下载页面
 
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