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基于UVM的EMMC控制器模块验证
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基于UVM的EMMC控制器模块验证
论文目录
 
摘要第1-6页
ABSTRACT第6-9页
第一章 绪论第9-13页
　　1.1 课题的背景及意义第9-10页
　　1.2 验证的研究状况第10-11页
　　1.3 论文研究内容与章节安排第11-13页
第二章 验证方法学第13-24页
　　2.1 验证理论第13-14页
　　2.2 System Verilog语言第14页
　　2.3 UVM验证方法学第14-23页
　　　　2.3.1 验证平台第15页
　　　　2.3.2 验证平台组件第15-16页
　　　　2.3.3 UVM的类库第16-17页
　　　　2.3.4 UVM的树形结构第17-18页
　　　　2.3.5 UVM中的transaction第18-19页
　　　　2.3.6 UVM中的factory机制第19页
　　　　2.3.7 UVM中的objection机制第19页
　　　　2.3.8 UVM中的phase机制第19-20页
　　　　2.3.9 UVM中的sequence机制第20-22页
　　　　2.3.10 UVM中的寄存器模型第22-23页
　　2.4 本章小结第23-24页
第三章 eMMC控制器模块的UVM验证方案第24-39页
　　3.1 eMMC控制器模块第24-28页
　　　　3.1.1 eMMC系统第25-28页
　　3.2 eMMC控制器模块功能介绍第28-29页
　　　　3.2.1 支持主机访问第28-29页
　　　　3.2.2 提供3种数据总线宽度第29页
　　　　3.2.3 输出时钟可控第29页
　　　　3.2.4 支持错误校验第29页
　　　　3.2.5 中断功能第29页
　　3.3 eMMC控制器模块系统级设计第29-32页
　　　　3.3.1 eMMC控制器模块结构图第29-30页
　　　　3.3.2 总线接口模块第30页
　　　　3.3.3 中断控制模块第30页
　　　　3.3.4 系统信号模块第30-31页
　　　　3.3.5 数据RAM接口模块第31页
　　　　3.3.6 PAD接口模块第31-32页
　　3.4 模块级设计第32-35页
　　　　3.4.1 命令和数据总状态机第32-33页
　　　　3.4.2 命令发送响应状态机设计第33-34页
　　　　3.4.3 数据的发送状态机设计第34页
　　　　3.4.4 数据的接收状态机设计第34-35页
　　3.5 eMMC控制器模块应用实物图第35页
　　3.6 eMMC控制器模块的UVM验证方案第35-38页
　　　　3.6.1 验证策划第35-36页
　　　　3.6.2 验证方案架构第36-38页
　　3.7 本章小结第38-39页
第四章 UVM验证组件的实现第39-55页
　　4.1 UVM验证平台的transaction第39-40页
　　4.2 UVM验证平台的interface第40-41页
　　4.3 UVM验证平台的sequence机制第41-45页
　　　　4.3.1 UVM验证平台的sequencer第41-42页
　　　　4.3.2 UVM验证平台的sequence第42-45页
　　4.4 UVM验证平台的driver第45-47页
　　4.5 UVM验证平台的monitor第47-48页
　　4.6 UVM验证平台的reference model第48-49页
　　4.7 UVM验证平台的scoreboard第49页
　　4.8 UVM验证平台的agent第49-50页
　　4.9 UVM验证平台的env第50-52页
　　4.10 UVM验证平台的base_test第52-54页
　　4.11 UVM验证平台的top第54页
　　4.12 本章小结第54-55页
第五章 eMMC控制器模块的验证仿真第55-64页
　　5.1 测试用例及仿真第56-61页
　　　　5.1.1 冒烟测试第56-58页
　　　　5.1.2 DUT读写功能测试第58-59页
　　　　5.1.3 随机约束激励测试第59-61页
　　　　5.1.4 异常测试用例第61页
　　5.2 验证平台覆盖率第61-63页
　　5.3 本章小结第63-64页
第六章 总结与展望第64-66页
　　6.1 总结第64页
　　6.2 展望第64-66页
致谢第66-67页
参考文献第67-70页
附录第70页

本篇论文共70页，点击这进入下载页面。
 
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