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基于0.18um CMOS工艺的时间数字转换器的设计与实现
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基于0.18um CMOS工艺的时间数字转换器的设计与实现
论文目录
 
摘要第1-5页
Abstract第5-11页
第1章 绪论第11-15页
　　1.1 课题背景及意义第11-12页
　　1.2 国内外研究现状第12-13页
　　1.3 本文的主要研究内容及结构安排第13-15页
第2章 时间数字转换器的基本原理第15-25页
　　2.1 TDC的基本原理第15页
　　2.2 TDC的性能指标第15-20页
　　　　2.2.1 静态参数第15-18页
　　　　2.2.2 动态参数第18-20页
　　2.3 时间数字转换器的分类第20-24页
　　　　2.3.1 模拟时间数字转换器第20页
　　　　2.3.2 门延时的时间数字转换器第20-23页
　　　　2.3.3 低于门延时的时间数字转换器第23-24页
　　2.4 本章小结第24-25页
第3章 双通道游标TDC的前端设计第25-37页
　　3.1 总体结构第25-26页
　　3.2 测试电路设计第26-28页
　　3.3 双通道游标延时线电路的设计第28-31页
　　　　3.3.1 延时单元第29-30页
　　　　3.3.2 D触发器第30-31页
　　3.4 读出电路和编码电路的设计第31-36页
　　　　3.4.1 半定制设计方法第31-32页
　　　　3.4.2 读出电路第32-33页
　　　　3.4.3 编码电路第33页
　　　　3.4.4 模块的功能仿真第33-34页
　　　　3.4.5 逻辑综合和动态仿真第34-36页
　　3.5 本章小结第36-37页
第4章 双通道游标TDC的物理设计和测试第37-49页
　　4.1 TDC的物理设计第37-43页
　　　　4.1.1 整体规划第37-38页
　　　　4.1.2 测试电路第38页
　　　　4.1.3 游标延时线电路第38-39页
　　　　4.1.4 读出电路和编码电路第39-42页
　　　　4.1.5 TDC的整体版图第42-43页
　　4.2 后仿真第43-45页
　　4.3 在片测试第45-47页
　　4.4 本章小结第47-49页
第5章 高性能TDC的设计第49-61页
　　5.1 提升游标型TDC性能的常用方法第49-52页
　　　　5.1.1 延时校准法第49-51页
　　　　5.1.2 层次法第51-52页
　　5.2 一种高性能TDC第52-55页
　　　　5.2.1 延时单元t的电路设计第52-54页
　　　　5.2.2 高精度TDC的电路设计第54-55页
　　5.3 高性能TDC的整体版图设计第55-57页
　　5.4 后仿真第57-59页
　　5.5 本章小结第59-61页
第6章 总结和展望第61-63页
　　6.1 工作总结第61页
　　6.2 工作展望第61-63页
致谢第63-65页
参考文献第65-67页
作者攻读硕士学位期间发表的论文第67页

本篇论文共67页，点击这进入下载页面。
 
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