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高速PCB板级信号完整性问题研究
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高速PCB板级信号完整性问题研究
论文目录
 
目录第1-8 页
图目录第8-10 页
表目录第10-11 页
摘要第11-12 页
ABSTRACT第12-13 页
第一章 绪论第13-16 页
　　· 背景第13 页
　　· 课题的实践意义第13-14 页
　　· 课题研究的工程背景第14 页
　　· 本文的主要研究任务和贡献第14-16 页
第二章 PCB结构与板级信号完整性问题第16-20 页
　　· PCB基本结构第16-17 页
　　　　· PCB基本类型第16-17 页
　　　　· PCB上的传输线第17 页
　　　　· PCB结构对信号传输性能的影响第17 页
　　· 信号模式与板级信号完整性问题第17-19 页
　　　　· 信号模式第17-18 页
　　　　· 高速 PCB板级信号完整性问题第18-19 页
　　2.3小结第19-20 页
第三章 串扰问题及其减小措施第20-23 页
　　· 串扰问题第20-21 页
　　　　· 串扰现象第20 页
　　　　· 串扰引起的噪声第20-21 页
　　· 串扰的危害与减小串扰的措施第21-22 页
　　　　· 串扰的危害第21 页
　　　　· 影响串扰的主要因素第21-22 页
　　　　· 减小串扰的措施第22 页
　　3.3小结第22-23 页
第四章 端接技术研究第23-30 页
　　· 信号的反射第23-24 页
　　· 阻抗匹配与端接方式第24-27 页
　　　　· 两种端接方式第24 页
　　　　· 并行端接方式第24-26 页
　　　　· 串行端接方式第26 页
　　　　· 多负载的端接方式第26-27 页
　　　　· 不同器件的端接方式选择第27 页
　　· 端接技术的仿真与分析第27-29 页
　　· 小结第29-30 页
第五章 板级信号完整性关键技术应用第30-39 页
　　· 高速 PCB过孔的设计与分析第30-35 页
　　　　· 过孔的基本概念第30-31 页
　　　　· 寄生电容和寄生电感的数学描述第31-32 页
　　　　· 高速 PCB过孔的设计第32-33 页
　　　　· 阻抗可控过孔的设计第33-35 页
　　5.2数模混合 PCB的设计第35-38 页
　　　　· 最小电感路径第35 页
　　　　· 信号跨电源分割现象第35-36 页
　　　　· 信号跨电源分割现象的数学描述第36-37 页
　　　　· 数模混合 PCB的设计第37-38 页
　　5.3小结第38-39 页
第六章 板级信号完整性问题的仿真与分析第39-60 页
　　6.1传统的 PCB设计方法第39-40 页
　　6.2基于信号完整性分析的 PCB设计方法第40-41 页
　　6.3常用仿真软件的介绍第41 页
　　6.4信号完整性分析模型第41-48 页
　　　　· SPICE模型第42 页
　　　　· IBIS模型第42-43 页
　　　　· IBIS模型与 SPICE模型仿真结果的比较第43-47 页
　　　　· 模型的选用第47 页
　　　　· 设计方法与现有 EDA软件的结合第47-48 页
　　6.5信号完整性问题的仿真过程第48-56 页
　　　　· 电流流向对串扰的影响第48-49 页
　　　　· 两线间距 P与平行长度 L对串扰的影响第49-50 页
　　　　· 干扰源信号频率及上升时间对串扰的影响第50-52 页
　　　　· 板级信号完整性仿真第52-56 页
　　6.6同类 I/O Buffer的替代方案第56-59 页
　　　　· 信号接口类型第56-58 页
　　　　· 同类I／O Buffer其它模型的替代方法第58-59 页
　　§· 小结第59-60 页
第七章 结束语第60-62 页
　　§7．1 主要工作及贡献第60-61 页
　　§7．2 课题展望第61-62 页
致谢第62-63 页
附录：攻读硕士期间发表的论文第63-64 页
参考文献第64-65 页

本篇论文共65页，点击这进入下载页面。
 
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