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基于Nios Ⅱ的FPGA-CPU调试技术研究
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基于Nios Ⅱ的FPGA-CPU调试技术研究
论文目录
致谢
第1-6 页
中文摘要
第6-7 页
ABSTRACT
第7-10 页
1 引言
第10-14 页
· 微处理器设计及验证技术现状
第10-12 页
· FPGA-CPU调试技术
第12-13 页
· FPGA-CPU
第12 页
· FPGA-CPU调试技术
第12-13 页
· 本文研究内容
第13-14 页
2 基于Nios II的CPU调试系统设计
第14-21 页
· 基于Nios II的FPGA-CPU调试系统
第14-16 页
· 微处理器IP核
第14-15 页
· Nios II嵌入式微处理器
第15-16 页
· 基于Nios II的FPGA-CPU调试系统软、硬件开发流程
第16-17 页
· 基于Nios II的FPGA-CPU调试系统的功能和系统结构
第17-19 页
· 基于Nios II的FPGA-CPU调试系统的功能
第17-18 页
· 基于Nios II的CPU调试系统结构
第18-19 页
· FPGA-CPU的接口设计要求
第19-21 页
· 可测试性设计
第19 页
· FPGA-CPU的接口设计要求
第19-21 页
3 硬件设计
第21-40 页
· 硬件设计的功能和规划
第21-22 页
· 硬件设计要实现的功能
第21 页
· 器件选择和硬件系统组成规划
第21-22 页
· 硬件架构
第22-25 页
· Avalon总线
第22-23 页
· Nios II处理器的外围设备接口
第23-24 页
· 硬件系统架构框图
第24-25 页
· Avalon自定制接口模块的VHDL设计
第25-34 页
· 双端口存储器读写控制模块
第25-26 页
· 通用寄存器组扫描模块
第26-28 页
· FPGA-CPU运行控制和扫描模块
第28-34 页
· SOPC系统的设计
第34-40 页
· Nios II处理器系统
第35-38 页
· SOPC系统的设计实现
第38-40 页
4 软件设计
第40-67 页
· 基于Nios II的系统软件开发环境
第40-46 页
· Nios II集成开发环境(IDE)
第40-41 页
· HAL系统库
第41-43 页
· 基于HAL配置文件
第43-46 页
· 自定义伪汇编程序的编译
第46-54 页
· 规则文件语法
第46-48 页
· 伪汇编程序格式
第48-49 页
· 编译器
第49-54 页
· CPU调试系统软件的功能和系统规划
第54-57 页
· 软件系统的功能分析
第54-55 页
· 软件系统规划
第55-57 页
· 基于Nios II的FPGA-CPU调试系统软件设计
第57-67 页
· 系统软件程序流程图
第57-60 页
· 自定义外设的结构声明和访问
第60-63 页
· 子程序设计
第63-67 页
5 FPGA-CPU的调试
第67-79 页
· 调试对象为无流水串行CPU
第67-75 页
· 加载无流水串行CPU
第67-69 页
· 测试程序
第69-70 页
· 各种调试模式下测试程序的运行结果
第70-75 页
· 调试对象为五级流水CPU
第75-78 页
· 测试总结
第78-79 页
6 结论
第79-80 页
参考文献
第80-82 页
附录 A
第82-86 页
附录 B
第86-89 页
作者简历
第89-91 页
学位论文数据集
第91页
本篇论文共
91
页,
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