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基于Nios Ⅱ的FPGA-CPU调试技术研究

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基于Nios Ⅱ的FPGA-CPU调试技术研究
论文目录
 
致谢第1-6 页
中文摘要第6-7 页
ABSTRACT第7-10 页
1 引言第10-14 页
  · 微处理器设计及验证技术现状第10-12 页
  · FPGA-CPU调试技术第12-13 页
    · FPGA-CPU第12 页
    · FPGA-CPU调试技术第12-13 页
  · 本文研究内容第13-14 页
2 基于Nios II的CPU调试系统设计第14-21 页
  · 基于Nios II的FPGA-CPU调试系统第14-16 页
    · 微处理器IP核第14-15 页
    · Nios II嵌入式微处理器第15-16 页
  · 基于Nios II的FPGA-CPU调试系统软、硬件开发流程第16-17 页
  · 基于Nios II的FPGA-CPU调试系统的功能和系统结构第17-19 页
    · 基于Nios II的FPGA-CPU调试系统的功能第17-18 页
    · 基于Nios II的CPU调试系统结构第18-19 页
  · FPGA-CPU的接口设计要求第19-21 页
    · 可测试性设计第19 页
    · FPGA-CPU的接口设计要求第19-21 页
3 硬件设计第21-40 页
  · 硬件设计的功能和规划第21-22 页
    · 硬件设计要实现的功能第21 页
    · 器件选择和硬件系统组成规划第21-22 页
  · 硬件架构第22-25 页
    · Avalon总线第22-23 页
    · Nios II处理器的外围设备接口第23-24 页
    · 硬件系统架构框图第24-25 页
  · Avalon自定制接口模块的VHDL设计第25-34 页
    · 双端口存储器读写控制模块第25-26 页
    · 通用寄存器组扫描模块第26-28 页
    · FPGA-CPU运行控制和扫描模块第28-34 页
  · SOPC系统的设计第34-40 页
    · Nios II处理器系统第35-38 页
    · SOPC系统的设计实现第38-40 页
4 软件设计第40-67 页
  · 基于Nios II的系统软件开发环境第40-46 页
    · Nios II集成开发环境(IDE)第40-41 页
    · HAL系统库第41-43 页
    · 基于HAL配置文件第43-46 页
  · 自定义伪汇编程序的编译第46-54 页
    · 规则文件语法第46-48 页
    · 伪汇编程序格式第48-49 页
    · 编译器第49-54 页
  · CPU调试系统软件的功能和系统规划第54-57 页
    · 软件系统的功能分析第54-55 页
    · 软件系统规划第55-57 页
  · 基于Nios II的FPGA-CPU调试系统软件设计第57-67 页
    · 系统软件程序流程图第57-60 页
    · 自定义外设的结构声明和访问第60-63 页
    · 子程序设计第63-67 页
5 FPGA-CPU的调试第67-79 页
  · 调试对象为无流水串行CPU第67-75 页
    · 加载无流水串行CPU第67-69 页
    · 测试程序第69-70 页
    · 各种调试模式下测试程序的运行结果第70-75 页
  · 调试对象为五级流水CPU第75-78 页
  · 测试总结第78-79 页
6 结论第79-80 页
参考文献第80-82 页
附录 A第82-86 页
附录 B第86-89 页
作者简历第89-91 页
学位论文数据集第91页

本篇论文共91页,点击这进入下载页面
 
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