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高速（6Mbit/s）位同步器的研究与实现
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高速（6Mbit/s）位同步器的研究与实现
论文目录
 
第一章 引言第1-10 页
第二章 位同步原理第10-18 页
　　· 同步的概念第10-11 页
　　· 位同步的发展概况第11-12 页
　　· 位同步方法的分类第12-15 页
　　　　· 插入导频法第12-14 页
　　　　· 直接法第14-15 页
　　· 位同步的性能指标第15-18 页
　　　　· 相位误差θ第15 页
　　　　· 同步建立时间t_s第15-16 页
　　　　· 同步保持时间t_c第16-17 页
　　　　· 同步带宽△f_s第17-18 页
第三章 开发平台介绍第18-27 页
　　· MATLAB 介绍第18-20 页
　　　　· MATLAB 简介第18 页
　　　　· MATLAB 编程技巧简介第18-20 页
　　· ISE 和MODELSIM 简介第20-22 页
　　　　· ISE 简介第20-21 页
　　　　· Modelsim 简介第21-22 页
　　· XILINX 公司FPGA/CPLD 设计流程及开发工具介绍第22-27 页
第四章 自同步法中锁相法的位同步原理第27-51 页
　　· 基于添扣脉冲的位同步方法第27-30 页
　　　　· 时差调整原理第27-28 页
　　　　· 添扣控制原理第28-29 页
　　　　· 相位比较(比相)原理第29-30 页
　　· 基于调整采样时刻的位同步方法第30-37 页
　　　　· 定时误差检测器(Timing error detector)第30-33 页
　　　　· 定时误差检测器的电路图第33-34 页
　　　　· 数字环滤波器(Digital loop filter)第34 页
　　　　· 数字环路滤波器的电路图第34-36 页
　　　　· 数字压控振荡器(DCO)第36 页
　　　　· 数字压控振荡器的电路图第36-37 页
　　· 基于内插的位同步方法第37-45 页
　　　　· 内插器第38-40 页
　　　　· 时钟误差提取模块第40-41 页
　　　　· 环路滤波器第41-42 页
　　　　· 控制器模块第42-45 页
　　· 性能比较第45-49 页
　　　　· 相位误差θ_e第45-46 页
　　　　· 同步建立时间t_s第46-47 页
　　　　· 同步保持时间t_c第47-48 页
　　　　· 同步带宽△f_s第48-49 页
　　· 应用范围第49-51 页
第五章 基于内插位同步方法的软件仿真、验证及VERILOG 实现第51-65 页
　　· GARDNER 算法的性能特性第51-53 页
　　　　· S 曲线第51-52 页
　　　　· 定时误差信号的方差第52-53 页
　　· 基于内插的位同步方法的仿真分析第53-60 页
　　　　· 开环仿真第54-56 页
　　　　· 闭环仿真第56-59 页
　　　　· 其它符号率的仿真第59-60 页
　　· 位同步的VERILOG 实现第60-65 页
　　　　· NCO 模块设计第60 页
　　　　· 内插模块设计第60-62 页
　　　　· 误差提取模块及步长更新模块第62-63 页
　　　　· 定时同步系统联调及仿真第63-65 页
第六章 自同步法中滤波法位同步原理及软硬件实现第65-78 页
　　· 1 比特伪码码同步器的数据源第65-67 页
　　· 2 比特伪码码同步器的同步模块的设计原理及VERILOG 软件实现第67-71 页
　　　　· 可编程数字滤波器第67-68 页
　　　　· 双边沿提取器第68-69 页
　　　　· 性能分析第69-70 页
　　　　· 6.144M 码率的2-1 位伪码序列的性能第70-71 页
　　· 硬件测试平台和软件的调试第71-78 页
　　　　· 硬件系统原理图及PCB 设计第71-73 页
　　　　· 基于硬件平台的软件调试第73-75 页
　　　　　　· ChipScope 简介第73-74 页
　　　　　　· CPLD 输出的伪码序列的调试第74 页
　　　　　　· FPGA 中同步功能的硬件调试第74-75 页
　　　　· 系统联调及结果第75-78 页
第七章 结论第78-79 页
参考文献第79-80 页
致谢第80-81 页
个人简历第81 页

本篇论文共81页，点击这进入下载页面。
 
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