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基于超深亚微米级的高性能低功耗SRAM的研究及设计
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基于超深亚微米级的高性能低功耗SRAM的研究及设计
论文目录
 
摘要第1-6页
abstract第6-7页
第一章 绪论第10-17页
　　　　1.1 课题研究背景与意义第10页
　　　　1.2 存储器的发展趋势第10-14页
　　　　　　　　1.2.1 高性能方向设计第11-12页
　　　　　　　　1.2.2 低功耗方向设计第12-14页
　　　　1.3 国内外的研究现状第14-15页
　　　　1.4 本文的主要内容与组织结构第15-17页
第二章 SRAM存储器的基本原理第17-35页
　　　　2.1 SRAM结构第17-20页
　　　　2.2 SRAM基本工作原理第20-21页
　　　　2.3 SRAM存储单元第21-26页
　　　　　　　　2.3.1 传统6T存储单元工作原理第22-25页
　　　　　　　　2.3.2 SRAM存储单元静态容限第25-26页
　　　　2.4 存储阵列第26-28页
　　　　　　　　2.4.1 大容量存储阵列布局第26-27页
　　　　　　　　2.4.2 小容量存储阵列布局第27-28页
　　　　2.5 灵敏放大器第28-31页
　　　　　　　　2.5.1 差分电流镜型灵敏放大器第28-29页
　　　　　　　　2.5.2 交叉耦合型灵敏放大器第29-30页
　　　　　　　　2.5.3 锁存型灵敏放大器第30-31页
　　　　2.6 预充电路第31-32页
　　　　2.7 译码电路第32-34页
　　　　　　　　2.7.1 静态CMOS电路第32-33页
　　　　　　　　2.7.2 动态逻辑电路第33-34页
　　　　2.8 本章小结第34-35页
第三章 高性能低功耗35*2048 SRAM设计第35-51页
　　　　3.1 存储单元阵列布局第35-36页
　　　　3.2 外部控制概述第36页
　　　　3.3 灵敏放大器及预充电路设计第36-38页
　　　　3.4 读写电路第38-39页
　　　　3.5 地址译码电路设计第39-45页
　　　　3.6 ELAT电路设计第45-46页
　　　　3.7 自测试和存储器冗余设计第46-48页
　　　　3.8 整体版图架构第48-50页
　　　　3.9 本章小结第50-51页
第四章 SRAM仿真验证第51-58页
　　　　4.1 灵敏放大器时序仿真验证第51页
　　　　4.2 ELAT时序仿真验证第51-54页
　　　　4.3 整体电路时序仿真验证第54-56页
　　　　4.4 整体电路功耗仿真第56-57页
　　　　4.5 本章小结第57-58页
第五章 总结与展望第58-60页
　　　　5.1 总结第58-59页
　　　　5.2 展望第59-60页
致谢第60-62页
参考文献第62-64页

本篇论文共64页，点击这进入下载页面。
 
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