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FT-异构多核DSP高速高效性能二级Cache/RAM的设计优化与验证

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FT-异构多核DSP高速高效性能二级Cache/RAM的设计优化与验证
论文目录
 
目录第1-7页
表目录第7-8页
图目录第8-10页
摘要第10-12页
ABSTRACT第12-14页
第一章 绪论第14-20页
  · 课题研究背景第14-16页
    · DSP芯片的发展趋势第14-15页
    · DSP芯片结构特点第15-16页
  · Cache技术的发展及优化策略第16-19页
    · 存储墙问题第16页
    · 多核处理器第16-17页
    · Cache优化相关策略分析第17-19页
  · 本文所做的研究工作第19页
  · 论文的组织结构第19-20页
第二章 X-QDSP存储结构的分析及其性能优化研究第20-31页
  · X-QDSP芯片结构第20-21页
  · X-QDSP的存储系统分析第21-23页
    · X-QDSP单核的两级存储结构第21-22页
    · X-QDSP的片上共享存储与核间高速传输第22-23页
  · X-QDSP二级Cache功能分析与结构设计第23-29页
    · L2 结构分析第24-26页
    · 面向多核的功能变化第26-27页
    · 面向多核的结构设计第27-29页
  · X-QDSP存储系统的性能优化途径分析第29-30页
  · 本章小结第30-31页
第三章 X-QDSP片内片外间存储通道的优化设计第31-45页
  · X-QDSP中数据存取通道分析和优化途径第31-35页
    · X-QDSP EMIF接口简介第31-34页
    · L2-EMIF存储通道的分析及优化途径第34-35页
  · X-QDSP存储系统的优化设计第35-39页
    · 侦听回写旁路的并行处理及合并机制的优化设计第35-36页
    · L2 与EMIF间写回缓冲的设计第36-38页
    · L2 与EMIF间请求字优先的设计第38-39页
    · 总线加宽的处理第39页
  · L2 部件EMIF读写模块的优化实现第39-44页
    · L2 写失效机制优化处理第40-42页
    · L2 读失效机制优化处理第42-44页
  · 本章小结第44-45页
第四章 L2 对EDMA高效访问片内SRAM的优化设计第45-57页
  · X-QDSP L2 与EDMA存储通道的分析和优化途径第45-49页
    · X-QDSP的EDMA简介第45-47页
    · DMA和 L2 SRAM的接口第47-48页
    · X-QDSP的L2 与EDMA存储通道的分析和优化途径第48-49页
  · EDMA读写L2SRAM处理机制的优化第49-53页
    · EDMA读写请求的接受缓冲设计第49-51页
    · EDMA读写L2SRAM侦听和发送的流水化处理第51-52页
    · X-QDSP基于侦听的优化处理第52-53页
  · 片内存储对EDMA访问片内SRAM归并处理优化设计第53-54页
  · L2 部件EDMA读写模块的优化设计第54-56页
  · 本章小结第56-57页
第五章 模拟验证及其结果分析和性能评测第57-71页
  · 验证方法与策略第57-59页
    · L2 模块级的功能验证第57页
    · X-QDSP的系统的验证第57-59页
    · L2 覆盖率测试第59页
  · L2 与EMIF、EDMA之间的相关的模拟验证第59-65页
    · L2 与EMIF之间存取通路的模拟第59-62页
    · L2 与EDMA数据存取通道的验证第62-65页
  · 模拟结果分析第65-67页
    · L2-EMIF存储通道的模拟结果分析第65-66页
    · L2-EDMA数据存取通道的模拟结果分析与性能评测第66-67页
  · 优化后对整个芯片性能的评测及数据分析第67-70页
  · 本章小结第70-71页
第六章 结束语第71-72页
致谢第72-73页
参考文献第73-77页
作者在学期间发表的论文第77 页

本篇论文共77页,点击这进入下载页面
 
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