基于Cadence的信号完整性设计及其在嵌入式系统中的应用

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基于Cadence的信号完整性设计及其在嵌入式系统中的应用

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基于Cadence的信号完整性设计及其在嵌入式系统中的应用

论文目录
摘要	第1-6 页
ABSTRACT	第6-10 页
第1章绪论	第10-16 页
· 课题研究背景	第10-13 页
· 信号完整性问题概述	第10-11 页
· 嵌入式系统概述	第11-13 页
· 嵌入式系统中信号完整性现象的提出	第13 页
· 课题研究目的和意义	第13-14 页
· 论文结构	第14-16 页
第2章信号完整性概述	第16-33 页
· 高速电路概述	第16-19 页
· 高速电路的定义	第16-17 页
· 高速电路产生的问题	第17-18 页
· 高速电路的设计流程	第18-19 页
· 传输线概述	第19-23 页
· 传输线的基本概念	第19-20 页
· 传输线的特性阻抗	第20-21 页
· 传输线的分类	第21-23 页
· 信号完整性基本问题	第23-32 页
· 反射的分析	第23-25 页
· 串扰的分析	第25-30 页
· 时序系统分析	第30-32 页
· 本章小节	第32-33 页
第3章信号完整性分析工具及基本问题分析仿真	第33-52 页
· Cadence软件的介绍	第33-35 页
· IBIS模型的介绍	第35-38 页
· IBIS模型的发展	第35-36 页
· IBIS模型的优缺点	第36-37 页
· IBIS模型的结构	第37-38 页
· 反射问题的处理	第38-47 页
· 反射的抑制和匹配	第38-41 页
· 反射产生失真问题的处理方式	第41-47 页
· 串扰影响因素的分析与仿真	第47-51 页
· 串扰线间距和平行耦合长度对串扰的影响	第47-49 页
· 信号频率对串扰的影响	第49-50 页
· 信号流向对串扰的影响	第50-51 页
· 其他因素对串扰的影响	第51 页
· 本章小节	第51-52 页
第4章嵌入式多媒体终端的硬件介绍	第52-58 页
· 嵌入式微处理器的概述	第52-55 页
· 多媒体终端系统硬件结构	第55-57 页
· 嵌入式系统中的信号完整性现象	第57 页
· 本章小节	第57-58 页
第5章嵌入式多媒体终端的信号完整性设计	第58-74 页
· 信号完整性设计准备工作	第58-60 页
· 设计叠层和阻抗	第58-59 页
· 确定关键网络	第59-60 页
· 预布局元器件	第60 页
· 添加IBIS模型	第60 页
· 关键网络的拓扑设计	第60-64 页
· 反射的信号完整性设计	第64-65 页
· 串扰的信号完整性设计	第65-68 页
· 系统时序的设计	第68 页
· 布线后仿真	第68-73 页
· 添加约束与布线	第68-69 页
· PCB板后仿真	第69-71 页
· PCB制板	第71-73 页
· 本章小节	第73-74 页
第6章结论	第74-76 页
· 总结	第74-75 页
· 展望	第75-76 页
参考文献	第76-78 页
附录	第78-80 页
致谢	第80-81 页
攻读学位期间参加的科研项目和成果	第81 页

本篇论文共81页，点击这进入下载页面。

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