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Turbo编译码多核DSP实现研究

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Turbo编译码多核DSP实现研究
论文目录
 
摘要第1-6页
ABSTRACT第6-15页
第一章 绪论第15-23页
  1.1 研究背景和意义第15-17页
    1.1.1 信道编码技术概述第15-16页
    1.1.2 Turbo码的提出第16-17页
    1.1.3 课题研究的意义第17页
  1.2 Turbo码的基本原理第17-20页
    1.2.1 Turbo码的编码结构第17-18页
    1.2.2 Turbo码的译码结构第18-20页
  1.3 Turbo码的研究与应用现状第20-21页
  1.4 本文的研究内容与结构安排第21-23页
第二章 系统概述与实现需求第23-32页
  2.1 系统概述第23-25页
  2.2 系统硬件实现平台第25-31页
    2.2.1 TMS320C6678简介第27-28页
    2.2.2 TI SYS/BIOS与多核开发架构第28-31页
  2.3 硬件实现的系统需求第31页
  2.4 本章小结第31-32页
第三章 TURBO码设计第32-57页
  3.1 分量码的选择第32-34页
  3.2 交织器的选择第34-37页
  3.3 迭代次数的选择第37-38页
  3.4 编码长度的选择第38-40页
  3.5 译码算法及其选择第40-46页
    3.5.1 MAP算法第40-42页
    3.5.2 Log-MAP算法第42-44页
    3.5.3 Max-Log-MAP算法第44页
    3.5.4 复杂度分析与性能仿真第44-46页
  3.6 编码速率对Turbo码性能的影响第46-47页
  3.7 Turbo码分块译码原理与仿真分析第47-53页
    3.7.1 简单分块译码第48-49页
    3.7.2 重叠分块译码第49-51页
    3.7.3 边界状态迭代分块译码第51-53页
  3.8 系统全链路下Turbo码的性能仿真第53-56页
  3.9 本章小结第56-57页
第四章 TURBO码多核DSP实现第57-77页
  4.1 发送端DSP设计与实现第57-61页
    4.1.1 RSC编码器设计与实现第58-59页
    4.1.2 交织器设计与实现第59-60页
    4.1.3 编码模块复杂度分析第60-61页
  4.2 接收端DSP设计与实现第61-73页
    4.2.1 主核Task设计与实现第62-65页
    4.2.2 从核Task设计与实现第65-67页
    4.2.3 IPC(Message Q)设计与实现第67-68页
    4.2.4 多核同步设计与实现第68-69页
    4.2.5 子块译码模块实现第69-72页
    4.2.6 译码模块复杂度分析第72-73页
  4.3 缓存一致性维护第73-74页
  4.4 DSP代码的优化第74-76页
  4.5 本章小结第76-77页
第五章 DSP平台与全链路测试结果第77-82页
  5.1 DSP自环测试结果第77-79页
  5.2 系统全链路测试结果第79-81页
  5.3 本章小结第81-82页
第六章 总结与展望第82-83页
  6.1 全文总结第82页
  6.2 后续工作展望第82-83页
致谢第83-84页
参考文献第84-87页
攻读硕士学位期间取得的成果第87-88页

本篇论文共88页,点击这进入下载页面
 
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