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JPEG2000中MQ高速解码器的FPGA实现研究
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JPEG2000中MQ高速解码器的FPGA实现研究
论文目录
 
摘要第1-6页
ABSTRACT第6-11页
符号对照表第11-12页
缩略语对照表第12-15页
第一章 绪论第15-21页
　　1.1 引言第15页
　　1.2 JPEG2000编解码系统的研究现状第15-17页
　　1.3 本文章节安排第17-21页
第二章 算法简介及系统整体架构设计第21-29页
　　2.1 引言第21页
　　2.2 JPEG2000编解码算法简介第21-26页
　　　　2.2.1 预处理第21-22页
　　　　2.2.2 离散小波变换第22-23页
　　　　2.2.3 均匀标量量化第23-24页
　　　　2.2.4 Tier-1 编解码第24-25页
　　　　2.2.5 Tier-2 编解码第25-26页
　　2.3 解码系统的设计结构第26-29页
第三章 MQ解码器的FPGA设计实现第29-61页
　　3.1 引言第29页
　　3.2 高级综合工具第29-37页
　　　　3.2.1 HLS的开发流程及特点第31-32页
　　　　3.2.2 HLS使用的用户约束第32-37页
　　3.3 MQ解码算法原理及FPGA实现的难点分析第37-48页
　　　　3.3.1 MQ算术编解码算法分析第37-47页
　　　　3.3.2 MQ解码器目前的研究现状第47-48页
　　3.4 MQ解码器的结构优化第48-55页
　　　　3.4.1 概率索引值的预测第49-50页
　　　　3.4.2 重新归一化A左移位数的确定第50-51页
　　　　3.4.3 C值更新方式以及压缩码流读取方式的的改进第51-52页
　　　　3.4.4 解码器的寄存器更新优化第52-55页
　　3.5 实验结果分析第55-59页
　　　　3.5.1 高级综合仿真约束与性能对比第55-58页
　　　　3.5.2 高级综合实现与RTL实现的解码器性能比较第58-59页
　　3.6 本章小结第59-61页
第四章 Tier-1 的并行调度实现第61-69页
　　4.1 引言第61页
　　4.2 Tier-1 码块编解码算法分析第61-63页
　　　　4.2.1 Tier-1 编解码结构第61-62页
　　　　4.2.2 Tier-1 编解码并行实现的可行性分析第62-63页
　　4.3 Tier-1 解码的并行调度方案设计与实现第63-67页
　　　　4.3.1 Tier-1 并行调度的结构设计第63-66页
　　　　4.3.2 实验仿真及结果分析第66-67页
　　4.4 本章小结第67-69页
第五章 总结与展望第69-71页
　　5.1 论文研究工作总结第69页
　　5.2 进一步的研究计划第69-71页
参考文献第71-73页
致谢第73-75页
作者简介第75-76页

本篇论文共76页，点击这进入下载页面。
 
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