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高速数据回放系统FPGA硬件架构设计与实现
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高速数据回放系统FPGA硬件架构设计与实现
论文目录
 
致谢第1-5页
摘要第5-6页
Abstract第6-12页
1 绪论第12-17页
　　1.1 论文的研究背景和意义第12-13页
　　1.2 国内外研究现状第13-15页
　　1.3 本文的主要研究内容第15-17页
2 系统整体架构第17-25页
　　2.1 系统功能及指标第17-18页
　　2.2 系统硬件方案第18-20页
　　2.3 FPGA硬件架构设计总体框架第20-21页
　　2.4 FPGA硬件架构设计难点第21-24页
　　　　2.4.1 高速DAC模块的控制第21-22页
　　　　2.4.2 USB3.0模块和FLASH阵列的交互设计第22页
　　　　2.4.3 FLASH阵列和高速DAC模块的交互设计第22-24页
　　2.5 本章小结第24-25页
3 传输模式FPGA硬件架构设计及实现第25-42页
　　3.1 USB3.0通信模块设计第25-31页
　　　　3.1.1 固件程序的设计第26-27页
　　　　3.1.2 FPGA控制程序的设计第27-31页
　　3.2 FLASH擦除模块设计第31-36页
　　　　3.2.1 FLASH芯片介绍第31-33页
　　　　3.2.2 FPGA控制程序设计第33-36页
　　3.3 FLASH编程模块设计第36-38页
　　3.4 USB3.0模块和FLASH阵列的交互设计第38-41页
　　3.5 本章小结第41-42页
4 回放模式FPGA硬件架构设计及实现第42-59页
　　4.1 FLASH读取模块设计第42-45页
　　4.2 高速DAC模块设计第45-51页
　　　　4.2.1 DAC芯片介绍第45-46页
　　　　4.2.2 DAC配置第46-48页
　　　　4.2.3 DAC数据传输第48-51页
　　4.3 时钟管理模块设计第51-53页
　　　　4.3.1 CDCM时钟同步芯片设计第51-52页
　　　　4.3.2 DCM时钟管理模块设计第52-53页
　　4.4 FLASH阵列和高速DAC的交互设计第53-57页
　　4.5 本章小结第57-59页
5 系统测试第59-70页
　　5.1 系统测试平台搭建第59-62页
　　　　5.1.1 上位机软件设计第59-61页
　　　　5.1.2 测试平台整合第61-62页
　　5.2 传输模式测试第62-65页
　　　　5.2.1 USB3.0通信模块第62-64页
　　　　5.2.2 FLASH编程模块第64-65页
　　5.3 回放模式测试第65-69页
　　　　5.3.1 FLASH读取模块第65-66页
　　　　5.3.2 高速DAC模块第66-69页
　　5.4 本章小结第69-70页
6 总结和展望第70-72页
　　6.1 本文小结第70-71页
　　6.2 未来工作展望第71-72页
参考文献第72-76页
作者简历第76页

本篇论文共76页，点击这进入下载页面。
 
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