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MELP基音检测算法FPGA实现研究
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MELP基音检测算法FPGA实现研究
论文目录
 
摘要第1-7页
ABSTRACT第7-12页
符号对照表第12-13页
缩略语对照表第13-16页
第一章 绪论第16-22页
　　1.1 引言第16页
　　1.2 低速率语音编码技术第16-17页
　　1.3 基音检测技术第17-19页
　　1.4 课题的研究背景与意义第19-20页
　　1.5 课题的研究现状第20页
　　1.6 本文主要内容与结构安排第20-22页
第二章 MELP基音检测算法第22-30页
　　2.1 MELP算法概述第22-24页
　　　　2.1.1 MELP算法主要特征第22-23页
　　　　2.1.2 MELP算法编解码流程第23-24页
　　2.2 MELP基音检测算法第24-30页
　　　　2.2.1 整数基音周期的粗估算第24-25页
　　　　2.2.2 分数基音周期的细计算第25-26页
　　　　2.2.3 最终基音周期的计算第26-30页
第三章 FPGA及ASMD图第30-38页
　　3.1 FPGA概述第30-32页
　　　　3.1.1 FPGA简介第30页
　　　　3.1.2 FPGA工作原理第30-31页
　　　　3.1.3 FPGA设计方法与思想第31-32页
　　3.2 有限状态机与ASMD图第32-38页
　　　　3.2.1 有限状态机第33-34页
　　　　3.2.2 ASMD图第34-38页
第四章 MELP基音检测算法的FPGA实现第38-76页
　　4.1 软硬件工具第38-39页
　　　　4.1.1 Vivado集成开发环境第38页
　　　　4.1.2 ZedBoard开发板第38-39页
　　4.2 基本设计方法第39-40页
　　4.3 基本运算单元的FPGA实现第40-46页
　　　　4.3.1 加法器的实现第40-43页
　　　　4.3.2 乘法器的实现第43-44页
　　　　4.3.3 移位器的实现第44-46页
　　4.4 常用计算模块的FPGA实现第46-56页
　　　　4.4.1 乘加模块的实现第46-49页
　　　　4.4.2 平方和计算模块的实现第49-52页
　　　　4.4.3 内积计算模块的实现第52-56页
　　4.5 主要功能模块的FPGA实现第56-71页
　　　　4.5.1 整数基音周期粗估算模块的实现第56-61页
　　　　4.5.2 分数基音周期细计算模块的实现第61-66页
　　　　4.5.3 最终基音周期计算模块的实现第66-71页
　　4.6 基音检测算法整体的FPGA实现第71-76页
第五章 性能分析第76-78页
　　5.1 FPGA设计的性能评价第76页
　　5.2 面积性能分析第76-77页
　　　　5.2.1 高层次综合工具Vivado HLS第76页
　　　　5.2.2 本文实现与Vivado HLS实现的面积性能对比第76-77页
　　5.3 速度性能分析第77页
　　5.4 结果性能分析第77-78页
第六章 总结与展望第78-80页
　　6.1 本文工作总结第78页
　　6.2 后续工作展望第78-80页
参考文献第80-84页
致谢第84-86页
作者简介第86-87页

本篇论文共87页，点击这进入下载页面。
 
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