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多路高速串行数据交换技术设计与实现

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多路高速串行数据交换技术设计与实现
论文目录
 
摘要第1-6页
ABSTRACT第6-12页
符号对照表第12-13页
缩略语对照表第13-17页
第一章 绪论第17-23页
  1.1 课题研究背景及意义第17-18页
  1.2 国内外相关研究第18-20页
    1.2.1 高速串行接口的研究现状第18页
    1.2.2 光收发模块的研究及发展方向第18-20页
  1.3 论文内容和章节安排第20-23页
第二章 多路高速串行数据交换技术方案设计与分析第23-33页
  2.1 高速大容量存储阵列总体方案分析第23-26页
  2.2 数据交换与控制板的设计第26-29页
    2.2.1 数据交换与控制板的设计第26-27页
    2.2.2 数据交换与控制板的核心芯片选型第27-29页
  2.3 多路高速串行数据交换技术方案设计第29-31页
  2.4 本章小结第31-33页
第三章 关键模块设计第33-67页
  3.1 高速串行技术的助推力第33-35页
    3.1.1 串行/解串器(SERDES)第33-34页
    3.1.2 线路编码技术第34页
    3.1.3 发送端预加重与接收端均衡技术第34-35页
  3.2 Virtex-6 GTH与GTX收发器的功能结构及其接口设计第35-52页
    3.2.1 Virtex-6 GTH收发器的功能结构第35-40页
    3.2.2 Virtex-6 GTH收发器接口设计第40-47页
    3.2.3 Virtex-6 GTX收发器接口设计第47-52页
  3.3 光纤串行数据交换模块的设计第52-62页
    3.3.1 光收发模块QSFP架构及工作原理第52-55页
    3.3.2 光纤链路硬件设计第55-56页
    3.3.3 光纤串行数据交换模块软件设计第56-62页
  3.4 采样串行数据交换模块软件设计第62-65页
  3.5 本章小结第65-67页
第四章 供电网络及时钟模块设计第67-87页
  4.1 供电网络设计第67-84页
    4.1.1 电源分配方案第67-77页
    4.1.2 基于Fusion Digital Power Designer软件的电源配置第77-84页
  4.2 时钟模块设计第84-86页
  4.3 本章小结第86-87页
第五章 实验测试与功能验证第87-99页
  5.1 测试环境搭建第87页
  5.2 基于IBERT高速接口通信测试第87-89页
  5.3 光纤串行数据交换模块测试第89-96页
  5.4 采样串行数据交换模块测试第96-98页
  5.5 本章小结第98-99页
第六章 总结与展望第99-101页
参考文献第101-103页
致谢第103-105页
作者简介第105-106页

本篇论文共106页,点击这进入下载页面
 
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