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DPSK解调系统的FPGA实现
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DPSK解调系统的FPGA实现
论文目录
 
摘要第1-6页
ABSTRACT第6-10页
符号对照表第10-11页
缩略词对照表第11-14页
第一章 绪论第14-18页
　　1.1 FPGA的现状及发展趋势第14-15页
　　1.2 FPGA技术的优点第15-16页
　　1.3 FPGA与软件无线电第16-18页
第二章 环路的整体框架第18-22页
　　2.1 Costas环工作原理第18-19页
　　2.2 符号同步环工作原理第19-22页
第三章 锁相技术原理第22-44页
　　3.1 锁相环的工作原理第22-25页
　　　　3.1.1 锁相环路的模型第22页
　　　　3.1.2 锁定与跟踪的概念第22-24页
　　　　3.1.3 环路的基本性能要求第24-25页
　　3.2 锁相环路的动态方程第25-30页
　　　　3.2.1 非线性相位模型第25-27页
　　　　3.2.2 线性相位模型第27-28页
　　　　3.2.3 环路的传输函数第28-30页
　　3.3 锁相环路的性能分析第30-44页
　　　　3.3.1 暂态信号响应第30-32页
　　　　3.3.2 环路的频率特性第32-34页
　　　　3.3.3 环路的稳定性第34-36页
　　　　3.3.4 非线性跟踪性能第36-38页
　　　　3.3.5 环路的捕获特性第38-40页
　　　　3.3.6 环路的噪声性能第40-44页
第四章 锁相环路的数字化模型第44-50页
　　4.1 数字鉴相器第44-45页
　　4.2 数字环路滤波器第45-46页
　　4.3 数控振荡器第46-47页
　　4.4 数字环路的动态方程第47-50页
第五章 输入信号建模与仿真第50-60页
　　5.1 DPSK调制信号原理及信号特征第50-51页
　　5.2 DPSK信号传输模型及仿真第51-52页
　　5.3 环路性能参数设计第52-53页
　　5.4 数字鉴相器设计第53-56页
　　5.5 环路滤波器及数控振荡器设计第56-58页
　　5.6 MATLAB载波同步环仿真第58-59页
　　5.7 Verilog载波同步环的仿真第59-60页
第六章 位同步的概念及实现方法第60-64页
　　6.1 位同步的概念第60-61页
　　6.2 数字锁相环同步法第61-64页
第七章 微分型位同步的FPGA实现第64-68页
　　7.1 微分型位同步的原理第64页
　　7.2 顶层模块的verilog实现第64-65页
　　7.3 双相时钟信号的Verilog实现第65-66页
　　7.4 微分鉴相模块的Verilog实现第66页
　　7.5 单稳态触发器的verilog实现第66页
　　7.6 控制及分频模块的verilog实现第66-67页
　　7.7 位同步形成及移相模块的verilog实现第67-68页
附录A第68-74页
附录B第74-90页
结论与展望第90-92页
参考文献第92-94页
致谢第94-96页
作者简介第96-97页

本篇论文共97页，点击这进入下载页面。
 
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