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带占空比校正的高速时钟接收电路研究与设计
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带占空比校正的高速时钟接收电路研究与设计
论文目录
 
摘要第1-6页
abstract第6-10页
第一章 绪论第10-16页
　　1.1 研究背景与意义第10-11页
　　1.2 研究历史与发展现状第11-14页
　　1.3 论文的主要创新点第14页
　　1.4 论文的结构安排第14-16页
第二章 高速时钟接收电路均衡技术的研究第16-30页
　　2.1 高速时钟接收电路设计的难点分析第16-17页
　　2.2 高速时钟接收电路均衡技术的原理第17-20页
　　2.3 连续时间线性均衡技术的研究分析第20-29页
　　　　2.3.1 无源连续时间线性均衡器第20-22页
　　　　2.3.2 源极负反馈跨导连续时间线性均衡器第22-23页
　　　　2.3.3 有源电感连续时间线性均衡器第23-25页
　　　　2.3.4 有源负反馈连续时间线性均衡器第25-27页
　　　　2.3.5 分离路径连续时间线性均衡器第27-29页
　　2.4 本章小结第29-30页
第三章 时钟占空比校正技术的研究第30-35页
　　3.1 时钟占空比校正的基本原理第30-34页
　　　　3.1.1 基于脉宽调制的占空比校正技术第30-33页
　　　　3.1.2 基于共模反馈的占空比校正技术第33-34页
　　3.2 时钟占空比校正的性能指标第34页
　　3.3 本章小结第34-35页
第四章 带占空比校正的高速时钟接收电路设计与分析第35-56页
　　4.1 时钟接收电路模拟前端的设计与分析第36-42页
　　　　4.1.1 模拟前端阻抗匹配网络的设计与分析第36-37页
　　　　4.1.2 片内共模产生电路的设计与分析第37-39页
　　　　4.1.3 前置连续时间线性均衡器的设计与分析第39-42页
　　4.2 时钟接收电路占空比校正的电路设计第42-50页
　　　　4.2.1 宽带放大器电路的设计第42-46页
　　　　4.2.2 电荷泵电路的设计第46-47页
　　　　4.2.3 环路滤波器与积分器的设计第47-49页
　　　　4.2.4 电压-电流转换器的设计第49-50页
　　4.3 时钟占空比校正环路的稳定性分析第50-53页
　　4.4 时钟接收电路的输出时钟总抖动分析第53-55页
　　4.5 本章小结第55-56页
第五章 高速时钟接收电路的版图设计与验证第56-69页
　　5.1 高速时钟接收电路的版图设计第56-57页
　　　　5.1.1 版图设计的注意事项第56-57页
　　　　5.1.2 电路的整体版图实现第57页
　　5.2 阻抗匹配网络及差分共模产生电路的仿真第57-62页
　　　　5.2.1 阻抗匹配网络仿真第57-59页
　　　　5.2.2 时钟差分共模产生电路的仿真第59-62页
　　5.3 时钟接收电路前置线性均衡器的性能仿真第62-65页
　　5.4 带占空比校正的高速时钟接收电路整体性能仿真第65-68页
　　　　5.4.1 高速时钟接收电路占空比校正的性能仿真第65-66页
　　　　5.4.2 高速时钟接收电路占空比校正环路稳定性仿真第66-67页
　　　　5.4.3 高速时钟接收电路输出时钟总抖动仿真第67-68页
　　5.5 本章小结第68-69页
第六章 全文总结与展望第69-71页
　　6.1 全文总结第69-70页
　　6.2 后续工作展望第70-71页
致谢第71-72页
参考文献第72-76页
攻读硕士学位期间取得的成果第76-77页

本篇论文共77页，点击这进入下载页面。
 
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