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基于SDR的64QAM调制解调器的FPGA设计实现

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基于SDR的64QAM调制解调器的FPGA设计实现
论文目录
 
摘要第1-6页
ABSTRACT第6-11页
第1章 绪论第11-15页
  1.1 研究背景第11-12页
  1.2 国内外研究现状第12-14页
    1.2.1 软件无线电发展状况第12-13页
    1.2.2 正交幅度调制技术发展状况第13-14页
  1.3 论文研究内容与章节安排第14-15页
第2章 64QAM技术原理与系统发射端设计结构第15-27页
  2.1 64QAM技术原理第15-17页
  2.2 MQAM调制方式的错误概率第17-18页
  2.3 64QAM通信系统发射端设计结构第18-26页
    2.3.1 信号加扰第18-19页
    2.3.2 信道编码第19-20页
    2.3.3 串并转换和格雷差分编码第20-21页
    2.3.4 星座映射第21-23页
    2.3.5 脉冲成形第23-25页
    2.3.6 正交载波调制第25页
    2.3.7 高斯白噪声信道第25-26页
  2.4 本章小结第26-27页
第3章 64QAM通信系统的接收端设计中的关键技术第27-40页
  3.1 带通采样第28-29页
  3.2 多速率信号处理第29-32页
    3.2.1 内插第29-30页
    3.2.2 抽取第30-31页
    3.2.3 内插和抽取相结合的采样速率转换第31-32页
  3.3 正交数字下变频第32-35页
    3.3.1 数控振荡器第32-34页
    3.3.2 最佳检测第34-35页
  3.4 同步算法第35-37页
    3.4.1 载波同步第35-36页
    3.4.2 符号同步第36-37页
  3.5 信道解码第37-38页
  3.6 本章小结第38-40页
第4章 64QAM通信系统的软硬件协同仿真第40-66页
  4.1 运用simulink对系统进行设计实现第40-41页
  4.2 基于simulink的系统模型的性能评价第41-48页
    4.2.1 信源发生第41-42页
    4.2.2 64QAM基带映射第42页
    4.2.3 成形滤波第42-43页
    4.2.4 载波发生第43-44页
    4.2.5 发射信号第44-45页
    4.2.6 高白信道第45页
    4.2.7 匹配滤波第45-46页
    4.2.8 接收信号的误码特性第46-48页
  4.3 运用硬件描述语言在FPGA上设计系统第48-61页
    4.3.1 信源发生与加扰第50-51页
    4.3.2 串并转换与多电平变换第51-52页
    4.3.3 信道编码第52-53页
    4.3.4 脉冲成形滤波器第53-54页
    4.3.5 NCO的FPGA设计第54-56页
    4.3.6 高斯白噪声信道的FPGA设计第56-57页
    4.3.7 DDC中降速滤波器的FPGA设计第57-60页
    4.3.8 载波同步的FPGA设计第60-61页
  4.4 基于FPGA的系统模型的性能评价第61-65页
    4.4.1 信号加扰第61页
    4.4.2 多电平转换与基带映射第61-62页
    4.4.3 脉冲成形第62-63页
    4.4.4 正交载波调制第63-64页
    4.4.5 相干解调第64-65页
  4.5 本章小结第65-66页
结论第66-68页
参考文献第68-71页
硕士学位期间发表的论文和取得的科研成果第71-72页
致谢第72页

本篇论文共72页,点击这进入下载页面
 
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