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基于SDR的64QAM调制解调器的FPGA设计实现
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基于SDR的64QAM调制解调器的FPGA设计实现
论文目录
摘要
第1-6页
ABSTRACT
第6-11页
第1章 绪论
第11-15页
1.1 研究背景
第11-12页
1.2 国内外研究现状
第12-14页
1.2.1 软件无线电发展状况
第12-13页
1.2.2 正交幅度调制技术发展状况
第13-14页
1.3 论文研究内容与章节安排
第14-15页
第2章 64QAM技术原理与系统发射端设计结构
第15-27页
2.1 64QAM技术原理
第15-17页
2.2 MQAM调制方式的错误概率
第17-18页
2.3 64QAM通信系统发射端设计结构
第18-26页
2.3.1 信号加扰
第18-19页
2.3.2 信道编码
第19-20页
2.3.3 串并转换和格雷差分编码
第20-21页
2.3.4 星座映射
第21-23页
2.3.5 脉冲成形
第23-25页
2.3.6 正交载波调制
第25页
2.3.7 高斯白噪声信道
第25-26页
2.4 本章小结
第26-27页
第3章 64QAM通信系统的接收端设计中的关键技术
第27-40页
3.1 带通采样
第28-29页
3.2 多速率信号处理
第29-32页
3.2.1 内插
第29-30页
3.2.2 抽取
第30-31页
3.2.3 内插和抽取相结合的采样速率转换
第31-32页
3.3 正交数字下变频
第32-35页
3.3.1 数控振荡器
第32-34页
3.3.2 最佳检测
第34-35页
3.4 同步算法
第35-37页
3.4.1 载波同步
第35-36页
3.4.2 符号同步
第36-37页
3.5 信道解码
第37-38页
3.6 本章小结
第38-40页
第4章 64QAM通信系统的软硬件协同仿真
第40-66页
4.1 运用simulink对系统进行设计实现
第40-41页
4.2 基于simulink的系统模型的性能评价
第41-48页
4.2.1 信源发生
第41-42页
4.2.2 64QAM基带映射
第42页
4.2.3 成形滤波
第42-43页
4.2.4 载波发生
第43-44页
4.2.5 发射信号
第44-45页
4.2.6 高白信道
第45页
4.2.7 匹配滤波
第45-46页
4.2.8 接收信号的误码特性
第46-48页
4.3 运用硬件描述语言在FPGA上设计系统
第48-61页
4.3.1 信源发生与加扰
第50-51页
4.3.2 串并转换与多电平变换
第51-52页
4.3.3 信道编码
第52-53页
4.3.4 脉冲成形滤波器
第53-54页
4.3.5 NCO的FPGA设计
第54-56页
4.3.6 高斯白噪声信道的FPGA设计
第56-57页
4.3.7 DDC中降速滤波器的FPGA设计
第57-60页
4.3.8 载波同步的FPGA设计
第60-61页
4.4 基于FPGA的系统模型的性能评价
第61-65页
4.4.1 信号加扰
第61页
4.4.2 多电平转换与基带映射
第61-62页
4.4.3 脉冲成形
第62-63页
4.4.4 正交载波调制
第63-64页
4.4.5 相干解调
第64-65页
4.5 本章小结
第65-66页
结论
第66-68页
参考文献
第68-71页
硕士学位期间发表的论文和取得的科研成果
第71-72页
致谢
第72页
本篇论文共
72
页,
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