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PVT偏差容忍电路的快速自适应频率系统设计

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PVT偏差容忍电路的快速自适应频率系统设计
论文目录
 
摘要第1-6页
Abstract第6-9页
第一章 绪论第9-15页
  1.1 论文背景与意义第9页
  1.2 国内外研究现状第9-12页
    1.2.1 基于片上时序监测的自适应技术第9-11页
    1.2.2 自适应时钟技术第11-12页
  1.3 论文研究内容及研究目标第12-13页
  1.4 论文组织结构第13-15页
第二章 自适应调节技术概述第15-27页
  2.1 数字电路的基本时序原理第15-17页
  2.2 PVT偏差分类分析第17-21页
    2.2.1 偏差的来源及分类第17-18页
    2.2.2 工艺偏差第18-20页
      2.2.2.1 工艺随机偏差的来源第18-19页
      2.2.2.2 工艺偏差的分类第19页
      2.2.2.3 工艺偏差对于时序的影响第19-20页
    2.2.3 电压偏差第20页
      2.2.3.1 电压偏差的来源第20页
      2.2.3.2 电压偏差对于时序的影响第20页
    2.2.4 温度偏差第20-21页
  2.3 常用的自适应频率调节技术第21-25页
    2.3.1 间接监测型第21页
    2.3.2 直接监测型第21-25页
      2.3.2.1 出错改错型第21-23页
      2.3.2.2 预测型第23-25页
  2.4 本章小结第25-27页
第三章 时序监测单元和快速时钟调节电路设计第27-51页
  3.1 时序监测单元的设计第27-38页
    3.1.1 时序监测单元电路结构第27-30页
    3.1.2 监测窗口设计第30-38页
      3.1.2.1 监测窗口设计理论分析第31-33页
      3.1.2.2 监测窗口配置模块第33-38页
  3.2 快速时钟调节电路第38-49页
    3.2.1 设计原理第38-39页
    3.2.2 快速时钟拉伸模块第39-45页
      3.2.2.1 时间数字转换器第41页
      3.2.2.2 相位时钟生成模块第41-43页
      3.2.2.3 时钟抖动分析第43-45页
    3.2.3 占空比调节模块第45-46页
    3.2.4 仿真结果分析第46-49页
  3.3 本章小结第49-51页
第四章 自适应频率调节系统结构与仿真分析第51-73页
  4.1 自适应频率调节设计第51-55页
    4.1.1 自适应频率调节系统结构第51-52页
    4.1.2 动态或门树第52-53页
    4.1.3 自适应频率控制状态机第53-55页
  4.2 验证平台设计第55-58页
    4.2.1 比特币芯片的验证平台第55-56页
    4.2.2 多电压域设计第56页
    4.2.3 AFS系统设计流程第56-58页
  4.3 混合仿真平台设计第58-62页
    4.3.1 HSIM-VCS混合仿真平台第58-59页
    4.3.2 PLLC模型第59-62页
      4.3.2.1 PLLC模型设计第59-61页
      4.3.2.2 PLLC模型验证第61-62页
  4.4 AFS功能验证第62-66页
    4.4.1 数字芯片功能验证第62-63页
    4.4.2 自适应频率调节验证第63-66页
      4.4.2.1 常规电压下自适应频率系统验证第63-65页
      4.4.2.2 低电压下自适应频率系统验证第65-66页
  4.5 仿真结果和分析第66-72页
    4.5.1 首次预警频率点分析第66-69页
    4.5.2 效能收益第69-70页
    4.5.3 与相关研究对比第70-72页
  4.6 本章小结第72-73页
第五章 总结与展望第73-75页
  5.1 总结第73页
  5.2 展望第73-75页
致谢第75-77页
参考文献第77-81页
作者简介第81页

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