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具有良好杂散和相位噪声特性的频率合成器研制
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具有良好杂散和相位噪声特性的频率合成器研制
论文目录
 
摘要第1-6页
ABSTRACT第6-10页
第1章 绪论第10-14页
　　1.1 课题研究的意义第10页
　　1.2 频率合成器及其发展现状第10-12页
　　1.3 研究内容及章节安排第12-14页
　　　　1.3.1 课题研究内容第12-13页
　　　　1.3.2 章节安排第13-14页
第2章 频率合成基本原理第14-31页
　　2.1 频率合成器的技术参数和评价指标第14-15页
　　　　2.1.1 频率范围和精度第14页
　　　　2.1.2 输出频率最小步进第14页
　　　　2.1.3 相位噪声第14-15页
　　　　2.1.4 杂散第15页
　　2.2 锁相环频率合成基本原理第15-21页
　　　　2.2.1 锁相环的工作原理第15-16页
　　　　2.2.2 锁相环的基本结构组成第16-19页
　　　　2.2.3 锁相环频谱纯度分析第19-21页
　　2.3 DDS频率合成基本原理第21-26页
　　　　2.3.1 DDS工作原理第21页
　　　　2.3.2 理想DDS频率合成器的频谱特性第21-23页
　　　　2.3.3 实际DDS输出信号频谱特性第23-26页
　　2.4 组合式频率合成器第26-29页
　　　　2.4.1 锁相环为DDS提供频率源的合成器方案第26-27页
　　　　2.4.2 DDS激励锁相环的频率合成方案第27-28页
　　　　2.4.3 DDS作锁相环分频器的频率合成方案第28页
　　　　2.4.4 DDS和锁相环环外混频的频率合成方案第28-29页
　　　　2.4.5 锁相环内插DDS的频率合成方案第29页
　　2.5 本章小结第29-31页
第3章 频率合成器方案设计第31-43页
　　3.1 频率合成器指标需求分析第31-32页
　　　　3.1.1 频率合成器的主要技术指标要求第31页
　　　　3.1.2 频率合成器指标需求分析第31-32页
　　3.2 频率合成器整体方案设计第32-35页
　　　　3.2.1 常见频率合成器方案第32页
　　　　3.2.2 系统方案的选取第32-33页
　　　　3.2.3 方案的可行性分析第33-35页
　　3.3 锁相环模块方案设计第35-37页
　　　　3.3.1 鉴相器的设计第35页
　　　　3.3.2 环路滤波器的设计第35-37页
　　　　3.3.3 压控振荡器的选择第37页
　　3.4 DDS模块方案设计第37-40页
　　　　3.4.1 DDS芯片的选取第37-38页
　　　　3.4.2 DDS时钟源的选取第38页
　　　　3.4.3 DDS输出滤波器的设计第38-40页
　　3.5 放大器模块方案设计第40-42页
　　　　3.5.1 放大器器件的选择第40页
　　　　3.5.2 放大器模块的滤波器设计第40页
　　　　3.5.3 放大器模块的衰减器设计第40-42页
　　3.6 本章小结第42-43页
第4章 频率合成器软硬件设计与实现第43-61页
　　4.1 硬件电路设计总体方案第43页
　　4.2 DDS模块的设计与实现第43-47页
　　　　4.2.1 AD9954电路设计第44-45页
　　　　4.2.2 DDS模块电源部分硬件实现第45-46页
　　　　4.2.3 电平匹配电路硬件实现第46页
　　　　4.2.4 输出带通滤波器硬件实现第46-47页
　　4.3 锁相环模块的设计与实现第47-51页
　　　　4.3.1 锁相环芯片ADF4002外围电路设计第47-49页
　　　　4.3.2 环路滤波器电路设计与实现第49页
　　　　4.3.3 压控振荡器电路设计与实现第49-51页
　　4.4 放大模块的设计与实现第51-54页
　　　　4.4.1 放大器芯片AD8354外围电路设计实现第51-52页
　　　　4.4.2 椭圆低通滤波器的设计与实现第52-54页
　　4.5 频率合成器软件设计第54-60页
　　　　4.5.1 频率合成器整体软件设计方案第54-55页
　　　　4.5.2 外部接口程序第55-57页
　　　　4.5.3 锁相环模块程序设计第57-59页
　　　　4.5.4 DDS模块程序设计第59-60页
　　4.6 本章小结第60-61页
第5章 频率合成器的测试第61-66页
　　5.1 待测技术指标第61页
　　5.2 测试仪器第61-62页
　　5.3 功能和性能测试第62-65页
　　5.4 本章小结第65-66页
结论第66-67页
参考文献第67-70页
致谢第70页

本篇论文共70页，点击这进入下载页面。
 
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