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基于MCS-51指令集的CPU硬核设计

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基于MCS-51指令集的CPU硬核设计

论文目录
致谢	第1-6 页
中文摘要	第6-7 页
ABSTRACT	第7-10 页
1 引言	第10-12 页
· 课题研究背景	第10 页
· 指令集的选择	第10-11 页
· 论文主要内容	第11-12 页
2 指令集	第12-16 页
· 指令集的发展	第12-13 页
· MCS-51指令集	第13-14 页
· 寻址方式	第14-16 页
3 系统级设计及RTL级验证	第16-34 页
· CPU系统结构	第16-17 页
· 流水线设计	第17 页
· 状态机设计	第17-18 页
· 划分及设计	第18-24 页
· 数据通路设计	第19-22 页
· 控制通路设计	第22-23 页
· 存储器的设计	第23-24 页
· 模块划分	第24-26 页
· 模块验证	第26-34 页
· ALU子模块验证	第26-27 页
· Decoder子模块验证	第27-30 页
· Memory_interface子模块验证	第30-32 页
· 系统整体功能验证	第32-34 页
4 逻辑综合	第34-58 页
· 逻辑综合的概念	第34-36 页
· 逻辑综合的流程	第36-43 页
· 定义综合库(Specify Libraries)	第36-38 页
· 读入RTL设计(Read Design)	第38-39 页
· 定义综合的环境约束(Define Design Environment)	第39-40 页
· 定义设计约束(Set Design Constraints)	第40-43 页
· 选择综合策略	第43-45 页
· 综合中的其他问题	第45-47 页
· 子模块的多次引用	第45-47 页
· Violation最大的模块的处理	第47 页
· 综合优化	第47-50 页
· 优化目标	第48 页
· 优化技巧	第48-50 页
· 综合结果分析	第50-52 页
· 分析设计问题	第51 页
· 分析时序问题	第51-52 页
· 存储器综合技术	第52-53 页
· 设计实例	第53-58 页
· 时钟综合	第53-54 页
· 存储器综合	第54 页
· I/O Pad的加入	第54-55 页
· 编译策略的选择	第55 页
· 结果分析	第55-58 页
5 版图设计	第58-80 页
· 数据准备	第58-60 页
· 导入设计	第60-61 页
· 布局规划(Floorplan)	第61-68 页
· 初始化布局	第61-63 页
· I/O Pad的放置	第63 页
· Macro Cell的放置	第63-65 页
· 电源网络规划	第65-67 页
· 布局	第67-68 页
· 时钟树综合(CTS)	第68-73 页
· Create Clock Tree Spec	第70 页
· Specify Clock Tree	第70 页
· Synthesis Clock Tree	第70-71 页
· Display Clock Tree	第71-73 页
· 布线	第73-74 页
· 预布线(Trial Route)	第73-74 页
· 准布线(Nano Route)	第74 页
· 时序分析	第74-77 页
· 数据输出	第77 页
· 设计规则检查	第77-79 页
· 版图后仿真	第79-80 页
6 结论	第80-82 页
参考文献	第82-84 页
作者简历	第84-88 页
学位论文数据集	第88页

本篇论文共88页，点击这进入下载页面。

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