高速数据发生器的系统时钟逻辑及程控电路设计

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高速数据发生器的系统时钟逻辑及程控电路设计

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高速数据发生器的系统时钟逻辑及程控电路设计

论文目录
摘要	第1-8 页
ABSTACT	第8-12 页
第一章引言	第12-15 页
· 高速数据发生器的发展概况	第12-13 页
· 本课题的实现目标和本文工作	第13-15 页
第二章系统时钟逻辑设计	第15-38 页
· 频率合成的主要技术方法	第15 页
· 系统时钟逻辑电路的体系结构设计	第15-16 页
· 系统时钟的DDS电路设计	第16-26 页
· DDS基本工作原理	第16-18 页
· DDS的杂散分析	第18-20 页
· AD9852的主要特性	第20-23 页
· DDS部分的电路设计	第23-26 页
· 系统时钟的DDS+PLL电路设计	第26-28 页
· 系统时钟控制逻辑设计	第28-34 页
· 可编程器件的选用	第28-29 页
· 控制逻辑总体设计方案	第29-30 页
· 控制逻辑的分模块设计	第30-33 页
· 系统时钟的控制软件	第33-34 页
· 系统时钟电路的PCB板设计	第34-38 页
· ECL电路的处理	第34-36 页
· 高速PCB板设计	第36-38 页
第三章高速数据发生器的GPIB接口的FPGA实现	第38-54 页
· 高速数据发生器GPIB接口功能概述	第38 页
· 高速数据发生器的GPIB接口的总体设计方法	第38-40 页
· 数据发生器的GPIB接口功能的状态机设计	第40-46 页
· 数据发生器GPIB接口的内部模块的设计	第46-54 页
· 读写寄存器的设计实现	第46-52 页
· 地址译码器的设计实现	第52-53 页
· 多线消息译码器的设计实现	第53-54 页
第四章电路调试	第54-58 页
· 系统时钟调试	第54-55 页
· 程控电路调试	第55-58 页
第五章结束语	第58-60 页
参考文献	第60-62 页
致谢	第62-64 页
个人简历及研究成果	第64 页

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